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技术资料  IEEE_Std_1364-2005_VerilogHDL

IEEE Standard for Verilog Hardware Description Language

https://www.eeworm.com/dl/869495.html

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IEEE Verilog

技术资料  8051core(vlog) RTL

MCU IP Core RISC RTL(verilog)

https://www.eeworm.com/dl/912911.html

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8051 core vlog

DSP编程  针对多DSP 共享总线的通用信号处理板卡, 介绍了基于PCI9054 和CPCI 总线的接口设计, 分析了通用WDM总线驱动程序的开发。采用Verilog HDL 用CPLD 设计控制时序实现了DS

针对多DSP 共享总线的通用信号处理板卡, 介绍了基于PCI9054 和CPCI 总线的接口设计, 分析了通用WDM总线驱动程序的开发。采用Verilog HDL 用CPLD 设计控制时序实现了DSP 和 CPCI 总线桥接器PCI9054 之间的普通传输和高速DMA 传输。驱动程序采用DriverWorks 和Windows 驱动开发包DDK 进行开发, 具有很好的通用性和可移植性。 ...

https://www.eeworm.com/dl/516/269440.html

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Verilog 9054 CPCI CPLD

VHDL/FPGA/Verilog 使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG

使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG，一个堆栈寄存器STACK。存储器寻址粒度为字节。数据存储以32位字对准。采用32位定长指令格式，采用Load/Store结构，ALU指令采用三地址格式。支持有符号和无符号整数加、减、乘、除运算，并支持浮点数 ...

https://www.eeworm.com/dl/663/321145.html

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CPU verilog FLAG 语言

其他  包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合

包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合

https://www.eeworm.com/dl/534/328513.html

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verilog VHDL HDL 计数器

其他书籍  暂时没有好的C资料了

暂时没有好的C资料了，先上传一本VERILOG书籍吧，verilog golden中文版，很不错的，欢迎下载

https://www.eeworm.com/dl/542/262404.html

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暂时

技术资料  FPGA

北航夏宇闻verilog讲稿ppt 名师讲堂让你快速学会fpga-Wen Yu Xia Beihang ppt teacher verilog script allows you to quickl

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FPGA

教程资料  HDL入门教程

　　Verilog HDL入门教程

https://www.eeworm.com/dl/fpga/doc/32589.html

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HDL 入门教程

可编程逻辑  HDL入门教程

　　Verilog HDL入门教程

https://www.eeworm.com/dl/kbcluoji/40058.html

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HDL 入门教程

VHDL/FPGA/Verilog 电梯控制电路

电梯控制电路，用verilog写

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电梯控制电路

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