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VHDL/FPGA/Verilog 减1计数器一、设计要求用Verilog HDL语言设计一个计数器。要求计数器具有异步置位/复位功能

减1计数器一、设计要求用Verilog HDL语言设计一个计数器。要求计数器具有异步置位/复位功能，可以进行自增和自减计数，其计数周期为2^N（N为二进制位数）。二、设计原理输入/输出说明： d：异步置数数据输入； q：当前计数器数据输出； clock：时钟脉冲； count_en：计数器计数使能控制（1：计数/0：停止计数）； updo ...

https://www.eeworm.com/dl/663/134176.html

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VHDL/FPGA/Verilog 本程式為使用Verilog語言寫控制DRAM的控制模塊, 可以簡易的控制DRAM IC, 本程式已經過系統驗證.

本程式為使用Verilog語言寫控制DRAM的控制模塊, 可以簡易的控制DRAM IC, 本程式已經過系統驗證.

https://www.eeworm.com/dl/663/181941.html

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DRAM Verilog 控制程式

VHDL/FPGA/Verilog practical_lift_controller 实用电梯控制器实用电梯控制系统block symbol file 实用电梯控制器的Verilog HDL程设计

practical_lift_controller 实用电梯控制器实用电梯控制系统block symbol file 实用电梯控制器的Verilog HDL程设计

https://www.eeworm.com/dl/663/342533.html

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practical_lift_controller Verilog symbol block

VHDL/FPGA/Verilog 使用VERILOG 语言产生PWM波。只需要使用处理器或内核直接配置相应的寄存器就可以输出PWM波。

使用VERILOG 语言产生PWM波。只需要使用处理器或内核直接配置相应的寄存器就可以输出PWM波。

https://www.eeworm.com/dl/663/387364.html

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PWM VERILOG 语言处理器

VHDL/FPGA/Verilog 键扫描处理程序 verilog 使用时钟为50Hz // 低电平为按下,高电平为断开 // 输出状态,1为键入,0为无键

键扫描处理程序 verilog 使用时钟为50Hz // 低电平为按下,高电平为断开 // 输出状态,1为键入,0为无键

https://www.eeworm.com/dl/663/416387.html

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verilog 50 Hz 处理程序

VHDL/FPGA/Verilog 此代码是用Verilog实现的以太网接口,在此基础上做修改,可以作为一般的以太网接口程序开发.

此代码是用Verilog实现的以太网接口,在此基础上做修改,可以作为一般的以太网接口程序开发.

https://www.eeworm.com/dl/663/163509.html

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Verilog 以太网接口代码修改

VHDL/FPGA/Verilog CRC校验串行实现方法,verilog源码,利用反馈线性移位寄存器的方法,实现简单,适用于串行通信协议中的CRC校验.

CRC校验串行实现方法,verilog源码,利用反馈线性移位寄存器的方法,实现简单,适用于串行通信协议中的CRC校验.

https://www.eeworm.com/dl/663/283378.html

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CRC verilog 串行实现方法

VHDL/FPGA/Verilog VCS-verilog compiled simulator是synopsys公司的产品.其仿真速度相当快,而且支持多种调用方式.该文档是一个不错的使用指南.

VCS-verilog compiled simulator是synopsys公司的产品.其仿真速度相当快,而且支持多种调用方式.该文档是一个不错的使用指南.

https://www.eeworm.com/dl/663/400712.html

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VCS-verilog simulator compiled synopsys

VHDL/FPGA/Verilog 用Verilog语言编写的FPGA控制PWM的程序.利用码盘脉冲进行调速,进行过简单试验,可用.没有经过长期验证.做简单修改即可应用!

用Verilog语言编写的FPGA控制PWM的程序.利用码盘脉冲进行调速,进行过简单试验,可用.没有经过长期验证.做简单修改即可应用!

https://www.eeworm.com/dl/663/369902.html

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Verilog FPGA PWM 语言

集成开发环境  NC-Verlog/NC-VHDL/NC-SIM 1.150

Cadence公司出品，很好的Verilog/VHDL仿真工具，其中NC-Verilog 的前身是著名的Verilog仿真软件：Verilog-XL，用于Verilog仿真；NC-VHDL,用于VHDL仿真；NC-Sim,是Verilog/VHDL混合语言仿真工具

https://www.eeworm.com/dl/547/13605.html

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NC-Verlog NC-VHDL NC-SIM 1.150

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