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推荐下载,verilog处理器设计实例.体现了结构描述和寄存器传输描述的应用

https://www.eeworm.com/dl/534/152706.html

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verilog 处理器传输

VHDL/FPGA/Verilog Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。

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https://www.eeworm.com/dl/663/176688.html

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Verilog Modsim iout HDL

VHDL/FPGA/Verilog 4-7segment led display Verilog code. Implemented at Stratix EP1S25 DSP development board.

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https://www.eeworm.com/dl/663/195746.html

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Implemented development segment display

VHDL/FPGA/Verilog 一个关于MEMORY设计的原代码,使用VERILOG编写的希望对大家有些帮助

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https://www.eeworm.com/dl/663/195975.html

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VERILOG MEMORY 代码编写

VHDL/FPGA/Verilog 用于生成GF(2^m)有限域中常数乘法器的Verilog HDL源文件的C程序

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https://www.eeworm.com/dl/663/247016.html

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Verilog HDL GF C程序

其他嵌入式/单片机内容  已经测试过的RISC8的verilog源码和说明还包括编译环境和测试程序等

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https://www.eeworm.com/dl/687/253982.html

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verilog RISC8 测试源码

其他书籍  次文件是华为的Verilog入门教程对于那些用VerilogHDL做硬件设计的人肯定有帮助！

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https://www.eeworm.com/dl/542/255201.html

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VerilogHDL Verilog 华为入门教程

VHDL/FPGA/Verilog USB芯片FT245BM读写代码,在Quartus II V7.2上测试成功!---Verilog语言.

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https://www.eeworm.com/dl/663/285189.html

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Quartus Verilog USB 245

VHDL/FPGA/Verilog 是一個用verilog寫成的加法器電路,可把七個元件加起來

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https://www.eeworm.com/dl/663/287764.html

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verilog 加法器元件

微处理器开发  利用verilog硬件描述语言编写的8为并行输入的常crc校验模块。hdlc子模块

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https://www.eeworm.com/dl/655/293973.html