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VHDL/FPGA/Verilog 用verilog设计了一个简洁而实用的I2C总线控制器

用verilog设计了一个简洁而实用的I2C总线控制器，对大家学习FPGA和I2C总线接口等相关方面的知识有较大的帮助。
https://www.eeworm.com/dl/663/324056.html
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VHDL/FPGA/Verilog 数字计算机的设计coric,利用 verilog实现,格式为.v格式.详细见文件注释

数字计算机的设计coric,利用 verilog实现,格式为.v格式.详细见文件注释
https://www.eeworm.com/dl/663/328665.html
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VHDL/FPGA/Verilog Synopsys的DesignWare库中采用的brentkung高速加法器Verilog源代码生成,附相关文档

Synopsys的DesignWare库中采用的brentkung高速加法器Verilog源代码生成,附相关文档
https://www.eeworm.com/dl/663/333179.html
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VHDL/FPGA/Verilog 鍵盤掃描ｖｅｒｉｌｏｇ硬體驗證可以將開發版鍵盤功能使用

鍵盤掃描ｖｅｒｉｌｏｇ硬體驗證可以將開發版鍵盤功能使用
https://www.eeworm.com/dl/663/335395.html
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VHDL/FPGA/Verilog ｖｅｒｉｌｏｇ實現算術運算後利用7段顯示器將結果輸出

ｖｅｒｉｌｏｇ實現算術運算後利用7段顯示器將結果輸出
https://www.eeworm.com/dl/663/335396.html
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VHDL/FPGA/Verilog 这个文件中提供了 verilog hdl 的在ultra edit32中编程所需要的语法

这个文件中提供了 verilog hdl 的在ultra edit32中编程所需要的语法
https://www.eeworm.com/dl/663/337197.html
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VHDL/FPGA/Verilog 基于FPGA的交通灯的设计 有Verilog HDL 源码、仿真图与引脚配置图

基于FPGA的交通灯的设计 有Verilog HDL 源码、仿真图与引脚配置图，已下载实现
https://www.eeworm.com/dl/663/341853.html
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VHDL/FPGA/Verilog 基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码

基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等
https://www.eeworm.com/dl/663/342528.html
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VHDL/FPGA/Verilog 这是一篇介绍用verilog语言实现viterbi译码和rake接收机的文章

这是一篇介绍用verilog语言实现viterbi译码和rake接收机的文章，实用性很强的，在这里也感谢这篇文章的作着
https://www.eeworm.com/dl/663/344237.html
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VHDL/FPGA/Verilog alteral FPGA VERILOG 利用 ROM DCFIFO 和RAM 实现高速到低速时钟域的数据传输

alteral FPGA VERILOG 利用 ROM DCFIFO 和RAM 实现高速到低速时钟域的数据传输 ，值得学习。
https://www.eeworm.com/dl/663/351812.html
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