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文章/文档  verilog_HDL的卡梅隆大学讲义很有启发英文

verilog_HDL的卡梅隆大学讲义很有启发英文

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verilog_HDL 大学讲义英文

压缩解压  H.264标准解码器全部verilog源码

H.264标准解码器全部verilog源码，包括帧内、帧间、变换编码、熵编码、滤波等所有模块

https://www.eeworm.com/dl/617/456110.html

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verilog 264 标准解码器

微处理器开发  三星SDRAM的verilog模型的完整源码

三星SDRAM的verilog模型的完整源码

https://www.eeworm.com/dl/655/456116.html

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verilog SDRAM 三星模型

VHDL/FPGA/Verilog Verilog-HDL程序设计实用教程收集

Verilog-HDL程序设计实用教程收集，内容丰富，设计技巧多样。

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Verilog-HDL 程序设计实用教程

通讯/手机编程  用verilog实现的epp与sram通信的程序

用verilog实现的epp与sram通信的程序

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verilog sram epp 通信

VHDL/FPGA/Verilog 采用Verilog语言实现了8255A的功能

采用Verilog语言实现了8255A的功能，并下载到了FPGA上进行了验证

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Verilog 8255A 语言

汇编语言  红绿灯Verilog程序很好很好很有用的

红绿灯Verilog程序很好很好很有用的

https://www.eeworm.com/dl/644/461175.html

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Verilog 红绿灯程序

其他嵌入式/单片机内容  This is OVM 2.0 source code .Very useful for developing system verilog Env

This is OVM 2.0 source code .Very useful for developing system verilog Env

https://www.eeworm.com/dl/687/464250.html

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developing verilog source useful

VHDL/FPGA/Verilog 使用Verilog实现基于FPGA的SDRAM控制器

使用Verilog实现基于FPGA的SDRAM控制器

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Verilog SDRAM FPGA 控制器

VHDL/FPGA/Verilog 移位运算器SHIFTER 使用Verilog HDL 语言编写

移位运算器SHIFTER 使用Verilog HDL 语言编写，其输入输出端分别与键盘/显示器LED 连接。移位运算器是时序电路，在J钟信号到来时状态产生变化， CLK 为其时钟脉冲。由S0、S1 、M 控制移位运算的功能状态，具有数据装入、数据保持、循环右移、带进位循环右移，循环左移、带进位循环左移等功能。 CLK 是时钟脉冲输入，通过键5 ...

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SHIFTER Verilog HDL 移位

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