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其他  verilog 语言去产生可以调节占空比的pwm波形去控制信号管的开通和关断

verilog 语言去产生可以调节占空比的pwm波形去控制信号管的开通和关断

https://www.eeworm.com/dl/534/418666.html

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verilog pwm 语言波形

软件设计/软件工程  东南大学Verilog讲义.rar 高级FPGA教学实验指导书－逻辑设计部分.pdf ...

东南大学Verilog讲义.rar 高级FPGA教学实验指导书－逻辑设计部分.pdf ...

https://www.eeworm.com/dl/684/420304.html

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Verilog FPGA

VHDL/FPGA/Verilog Verilog语言对SRAM的操作,也提一些简单的快速操作SRAM的技巧。

Verilog语言对SRAM的操作,也提一些简单的快速操作SRAM的技巧。

https://www.eeworm.com/dl/663/424904.html

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SRAM Verilog 操作语言

操作系统开发  实现fifo的基本功能。使用Verilog能够实现的同步数据先入先出功能

实现fifo的基本功能。使用Verilog能够实现的同步数据先入先出功能，简单易懂，并带有相应的测试文件

https://www.eeworm.com/dl/531/426538.html

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Verilog fifo 数据

VHDL/FPGA/Verilog 基于Verilog HDL的16位超前进位加法器分为3个功能子模块

基于Verilog HDL的16位超前进位加法器分为3个功能子模块

https://www.eeworm.com/dl/663/447596.html

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Verilog HDL 进位加法器

其他  verilog HDl 交通灯的实现,而且这是有别于一般的vhdl语言

verilog HDl 交通灯的实现,而且这是有别于一般的vhdl语言

https://www.eeworm.com/dl/534/449043.html

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verilog vhdl HDl 交通灯

VHDL/FPGA/Verilog 用VERILOG写的8位十进制频率计注释非常清晰有助菜鸟学习

用VERILOG写的8位十进制频率计注释非常清晰有助菜鸟学习

https://www.eeworm.com/dl/663/464425.html

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VERILOG 8位十进制频率计

VHDL/Verilog/EDA源码  十六进制转十进制程序，采用verilog语言编写，cycloneiii上测试可用

十六进制转十进制程序，采用verilog语言编写，cyclongiii上测试可用

https://www.eeworm.com/dl/512498.html

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cycloneiii verilog 十六进制十进制程序测试

技术资料  IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件: module

IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件:module i2c_dri&nbsp; &nbsp; #(&nbsp; &nbsp; &nbsp; parameter&nbsp; &nbsp;SLAVE_ADDR = 7&#39;b1010000&nbsp; &nbsp;,&nbsp; //EEPROM从机地址&nbsp; &nbsp; &nbsp; parameter&nbsp; &nbsp;CLK_FREQ&nbsp; &nbsp;= 26&#39;d50_000_000, //模块输入的时钟频率 ...

https://www.eeworm.com/dl/745257.html

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iic 接口 e2prom at24c64 verilog 驱动

技术资料  Verilog HDL数字集成电路设计原理与应用第2版 297页

高清电子书-Verilog HDL数字集成电路设计原理与应用第2版

https://www.eeworm.com/dl/828866.html

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verilog hdl 数字集成电路

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