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通讯/手机编程  积分梳状滤波器(CIC)verilog设计.rar

积分梳状滤波器(CIC)verilog设计.rar

https://www.eeworm.com/dl/527/492091.html

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VHDL/FPGA/Verilog 基于verilog hdl的UART串口发送子程序。

基于verilog hdl的UART串口发送子程序。

https://www.eeworm.com/dl/663/492763.html

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verilog UART hdl 串口发送

通讯/手机编程  11阶滤波器的verilog基本代码描述

11阶滤波器的verilog基本代码描述

https://www.eeworm.com/dl/527/493828.html

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verilog 滤波器代码

VHDL/Verilog/EDA源码  Verilog环境下的Turbo编/译码器实现

Turbo码的verilog实现，可以运行。

https://www.eeworm.com/dl/506797.html

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verilog turbo

EDA相关  硬件描述语言Verilog 第四版

硬件描述语言Verilog  清华大学出版社刘明业蒋敬旗等译  学习Verilog的一本很好的资料   

https://www.eeworm.com/dl/509959.html

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Verilog

技术教程  硬件描述语言Verilog（第四版）

硬件描述语言Verilog（第四版）正文

https://www.eeworm.com/dl/510260.html

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硬件描述语言 Verilog

源码  （4200,4096,17）BCH 编码器Verilog设计

本设计采用Verilog实现（4200,4096，17）的BCH 编码设计。

https://www.eeworm.com/dl/513070.html

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BCH 编码器 Verilog

应用设计  verilog设计三分频器代码

用verilog编写的三分频器代码，用modelsim测试没有问题，有问题请反馈给我

https://www.eeworm.com/dl/514224.html

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verilog 三分频代码

书籍  数字系统设计与Verilog_HDL_王金明

数字系统设计,数字系统设计,数字系统设计

https://www.eeworm.com/dl/516857.html

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Verilog_HDL 数字系统设计

源码  LPC master verilog source（内附LPC标准协议文档）

用户接口Wishbone bus 接口，驱动LPC master去主动访问 slave 寄存器表（地址可更改）读取到寄存器封装到用户层可按要求更改设计

https://www.eeworm.com/dl/521744.html

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LPC Wishbone Verilog Specification

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通讯/手机编程  积分梳状滤波器(CIC)verilog设计.rar

VHDL/FPGA/Verilog 基于verilog hdl的UART串口发送子程序。

通讯/手机编程  11阶滤波器的verilog基本代码描述

VHDL/Verilog/EDA源码  Verilog环境下的Turbo编/译码器实现

EDA相关  硬件描述语言Verilog 第四版

技术教程  硬件描述语言Verilog（第四版）

源码  （4200,4096,17）BCH 编码器Verilog设计

应用设计  verilog设计三分频器代码

书籍  数字系统设计与Verilog_HDL_王金明

源码  LPC master verilog source（内附LPC标准协议文档）