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VHDL/FPGA/Verilog vhdl写的完整i2c代码,有仿真文件,是清华的人写的,质量可靠,请大家交流,qq:398087764
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电子书籍 vhdl数字时钟设计 目的
vhdl数字时钟设计
目的，原理仿真
源程序
VHDL/FPGA/Verilog 拿verilog和vhdl编写的串口通信代码(可综合)
拿verilog和vhdl编写的串口通信代码(可综合)
VHDL/FPGA/Verilog 这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器，在运用时，不需要阅读VHDL源代码，只需要把clk_div2n.vhd加入当前工程便可以直接调用clk_div2n.bsf。
VHDL/FPGA/Verilog VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效
VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效，清零端为clrn,进位输出为co。
VHDL/FPGA/Verilog VHDL源代码.设计一个模为4的计数器
VHDL源代码.设计一个模为4的计数器，并在实验箱上用七段数码管显示结果
VHDL/FPGA/Verilog 本文件是实现任意整数分频的VHDL代码,愿与大家分享!
本文件是实现任意整数分频的VHDL代码,愿与大家分享!
系统设计方案 用VHDL设计了一种2DPSK信号产生器
用VHDL设计了一种2DPSK信号产生器，测试和实际应用表明其性能稳定可靠。
VHDL/FPGA/Verilog FPGA Express VHDL Reference Manual,对学习VHDL的人来说很好
FPGA Express VHDL Reference Manual,对学习VHDL的人来说很好
VHDL/FPGA/Verilog 16b20b编解码VHDL代码.
16b20b编解码VHDL代码.