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VHDL/FPGA/Verilog
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这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器
VHDL/FPGA/Verilog
2 K
140 次下载
2015-08-23
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
Numb_pqc
发布时间
2015-08-23 00:34
下载统计
140
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2 积分
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器 - 资源详细说明
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器,在运用时,不需要阅读VHDL源代码,只需要把clk_div2n.vhd加入当前工程便可以直接调用clk_div2n.bsf。
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器 - 源码文件列表
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