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技术资料 王金明：《Verilog HDL 程序设计教程》及配套源码.rar

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->王金明：《Verilog HDL 程序设计教程》及配套源码.rar
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VHDL/FPGA/Verilog 介绍Verilog HDL, 内容包括： – Verilog应用 – Verilog语言的构成元素 – 结构级描述及仿真 – 行为级描述及仿真 – 延时的特点及说明 – 介绍Verilog

介绍Verilog HDL, 内容包括： – Verilog应用 – Verilog语言的构成元素 – 结构级描述及仿真 – 行为级描述及仿真 – 延时的特点及说明 – 介绍Verilog testbench &#8226 激励和控制和描述 &#8226 结果的产生及验证 – 任务task及函数function – 用户定义的基本单元(primitive) – 可综合的Verilog描述风格 ...
https://www.eeworm.com/dl/663/492784.html
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技术书籍 Verilog-HDL实践与应用系统设计-210页-18.0M.rar

专辑类----可编程逻辑器件相关专辑 Verilog-HDL实践与应用系统设计-210页-18.0M.rar
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技术书籍 Verilog-HDL实践与应用系统设计-210页-18.0M.pdf

专辑类-可编程逻辑器件相关专辑-96册-1.77G Verilog-HDL实践与应用系统设计-210页-18.0M.pdf
https://www.eeworm.com/dl/537/5971.html
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技术书籍 Verilog HDL Synthesis, A Practical Primer

·Verilog HDL Synthesis, A Practical Primer
https://www.eeworm.com/dl/537/14654.html
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VHDL/FPGA/Verilog 我用过的verilog hdl写的SDRAM core源程序,经过测试应用

我用过的verilog hdl写的SDRAM core源程序,经过测试应用
https://www.eeworm.com/dl/663/135717.html
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其他 pli_handbook_examples_pc verilog hdl 与C的接口的典型例子

pli_handbook_examples_pc verilog hdl 与C的接口的典型例子
https://www.eeworm.com/dl/534/172784.html
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VHDL/FPGA/Verilog 用verilog hdl硬件描述语言实现多人抢答器功能

用verilog hdl硬件描述语言实现多人抢答器功能，有计时，计分，报警等功能。
https://www.eeworm.com/dl/663/225912.html
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软件工程 Verilog HDL数字设计与综合 夏宇闻译（第二版）

Verilog HDL数字设计与综合 夏宇闻译（第二版）
https://www.eeworm.com/dl/540/238055.html
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VHDL/FPGA/Verilog 占用资源少的verilog HDL uart接口；采用固定波特率115200

占用资源少的verilog HDL uart接口；采用固定波特率115200，可以修改程序中的分频来修改波特率，模式为1个启始位，8位数据位，1个停止位；带1字节缓存；当缓存空时输出空信号
https://www.eeworm.com/dl/663/249350.html
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