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Verilog HDL 的查询结果
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技术资料 systemverilog+数字系统设计 Digital System Design with SystemVerilog
国外system verilog的教材,从最基础的数字电路讲起,覆盖system verilog的各个方面
技术资料 testbench简单教程
verilog的testbech写法教程
技术资料 DES RTL code
DES source RTL verilog code
VHDL/FPGA/Verilog 课程设计要求设计并用FPGA实现一个数字频率计
课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部时钟: 1024Hz 测量波形: 方波 Vp-p = 3~5 V 硬件设备:Altera Flex10K10 五位数码管 LED发光二极管 编程语言:Verilog HDL / VHDL ...
系统设计方案 本文首先讨论了以太网介质访问控制MAC的功能和工作过程。接着介绍了以太网MAC芯片的一种设计方案
本文首先讨论了以太网介质访问控制MAC的功能和工作过程。接着介绍了以太网MAC芯片的一种设计方案,对MAC的功能进行了逻辑划分。据此可以用Verilog HDL或VHDL来加以描述,并进一步用FPCA或ASIC来加以实现,也可做成以太网MAC核.
技术资料 一种用于浮点DSP的流水线结构DMA设计
· 摘要:  本文提出了一种用于32位浮点DSP处理器的改进型DMA结构.采用两级数据流水线结构,外设与内部存储器的数据传输速率比原来提高了一倍.使用verilog HDL语言对其进行编码和仿真,仿真结果表明工作频率达到250MHz以上,满足设计要求.   ...
技术资料 基于FPGA数据采集
对于数字视频的采集 基于FPGA的HDL语言编写的数字采集,数字的存储
技术资料 Matlab_simulink在FPGA设计中的应用
matlab与FPGA结合使用
利用SIMULINK构建模块转换成HDL文件在FPGA中使用