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VHDL/FPGA/Verilog CRC校验串行实现方法,verilog源码,利用反馈线性移位寄存器的方法,实现简单,适用于串行通信协议中的CRC校验.

CRC校验串行实现方法,verilog源码,利用反馈线性移位寄存器的方法,实现简单,适用于串行通信协议中的CRC校验.
https://www.eeworm.com/dl/663/283378.html
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技术资料 空间对接装置通用算法的FPGA实现

本文简述空间对接的基本概念,对空间对接装置中的通用算法,包括预处理、自动门限和隔点差分的FPGA 实现进行了详尽的分析,对VHDL 与Verilog HDL 两种硬件描述语言的区别加以
https://www.eeworm.com/dl/930103.html
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技术资料 WritingTestbenchesFunctionaVerificationofHDLModels

Writing-TestbenchesFunctiona-Verification-of-HDL Models
https://www.eeworm.com/dl/885625.html
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VHDL/FPGA/Verilog VCS-verilog compiled simulator是synopsys公司的产品.其仿真速度相当快,而且支持多种调用方式.该文档是一个不错的使用指南.

VCS-verilog compiled simulator是synopsys公司的产品.其仿真速度相当快,而且支持多种调用方式.该文档是一个不错的使用指南.
https://www.eeworm.com/dl/663/400712.html
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技术资料 FPGA串口通信

FPGA实现RS-232串口收发的仿真过程(Quartus+Synplify+ModelSim)(2007-09-11 12:17:37) 结合FPGA的开发流程,主要走了以下几步: 1. 文本程序输入(Verilog HDL) 2. 功能仿真(ModelSim,查看逻辑功能是否正确,要写一个Test Bench)
https://www.eeworm.com/dl/980452.html
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技术资料 Allegro design entry

Allegro design entry HDL training manual book
https://www.eeworm.com/dl/902580.html
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VHDL/FPGA/Verilog 用Verilog语言编写的FPGA控制PWM的程序.利用码盘脉冲进行调速,进行过简单试验,可用.没有经过长期验证.做简单修改即可应用!

用Verilog语言编写的FPGA控制PWM的程序.利用码盘脉冲进行调速,进行过简单试验,可用.没有经过长期验证.做简单修改即可应用!
https://www.eeworm.com/dl/663/369902.html
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集成开发环境 NC-Verlog/NC-VHDL/NC-SIM 1.150

Cadence公司出品,很好的Verilog/VHDL仿真工具,其中NC-Verilog 的前身是著名的Verilog仿真软件:Verilog-XL,用于Verilog仿真;NC-VHDL,用于VHDL仿真;NC-Sim,是Verilog/VHDL混合语言仿真工具
https://www.eeworm.com/dl/547/13605.html
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技术资料 NC-Verlog/NC-VHDL/NC-SIM 1.150

Cadence公司出品,很好的Verilog/VHDL仿真工具,其中NC-Verilog 的前身是著名的Verilog仿真软件:Verilog-XL,用于Verilog仿真;NC-VHDL,用于VHDL仿真;NC-Sim,是Verilog/VHDL混合语言仿真工具
https://www.eeworm.com/dl/884548.html
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精品软件 NC-VERLOG/NC-VHDL/NC-SIM 1.150

Cadence公司出品,很好的Verilog/VHDL仿真工具,其中NC-Verilog 的前身是著名的Verilog仿真软件:Verilog-XL,用于Verilog仿真;NC-VHDL,用于VHDL仿真;NC-Sim,是Verilog/VHDL混合语言仿真工具
https://www.eeworm.com/soft/171.html
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