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it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].you can use this code in any DSP project in which data entry is required.

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synthesize simulator modelsim verilog

嵌入式/单片机编程  I2C总线的verilog语言实现

I2C总线的verilog语言实现，稍经修改即可应用于实际工程

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verilog I2C 总线语言

GPS编程  GPS中C/A码产生简单的Verilog逻辑产生

GPS中C/A码产生简单的Verilog逻辑产生

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Verilog GPS 逻辑

加密解密  Verilog实现的SHA256/SHA512算法

Verilog实现的SHA256/SHA512算法，已仿真和验证

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SHA Verilog 256 512

VHDL/FPGA/Verilog 三段式Verilog的IDE程序

三段式Verilog的IDE程序，但只有DMA部分，需要自己添加PIO的代码

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Verilog IDE 三段式程序

汇编语言  用Verilog实现的电子时钟显示器

用Verilog实现的电子时钟显示器，可以显示24小时制的时间

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Verilog 电子时钟显示器

VHDL/FPGA/Verilog sram读模块基于FPGA的实现 verilog源代码

sram读模块基于FPGA的实现 verilog源代码

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verilog sram FPGA 模块

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单片机开发  视频解压缩程序（用verilog语言实现）

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