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单片机开发  一个用verilog编写的数字时钟

一个用verilog编写的数字时钟，最后在8段数码管上显示出来，对于初学verilog的有一定的帮助，是一个工程文件

https://www.eeworm.com/dl/648/340731.html

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verilog 编写数字时钟

VHDL/FPGA/Verilog 一个异步FIFO的verilog实现论文

一个异步FIFO的verilog实现论文

https://www.eeworm.com/dl/663/341837.html

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verilog FIFO 论文

VHDL/FPGA/Verilog 有关verilog的硬件实现VGA设计的代码。

有关verilog的硬件实现VGA设计的代码。

https://www.eeworm.com/dl/663/341897.html

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verilog VGA 硬件实现代码

Delphi控件源码  关于verilog的各个基本模块的源代码

关于verilog的各个基本模块的源代码，如加法器，寄存器，选择器及各个测试文件

https://www.eeworm.com/dl/666/342096.html

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verilog 模块源代码

VHDL/FPGA/Verilog verilog中调用门级电路的实验程序

verilog中调用门级电路的实验程序，实现了门级舰模

https://www.eeworm.com/dl/663/348173.html

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verilog 门级电路实验

VHDL/FPGA/Verilog Verilog实现 spi接口的FPGA实现通过仿真

Verilog实现 spi接口的FPGA实现通过仿真，修改后即可应用

https://www.eeworm.com/dl/663/348886.html

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Verilog FPGA spi 接口

VHDL/FPGA/Verilog 此程序为Verilog控制ADC的全部程序

此程序为Verilog控制ADC的全部程序，已检验可以应用

https://www.eeworm.com/dl/663/351601.html

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Verilog ADC 程序控制

VHDL/FPGA/Verilog verilog编写随机数产生源程序

verilog编写随机数产生源程序，在硬件电路设计中应用广泛。本程序是在LFSR and a CASR 基础上实现的

https://www.eeworm.com/dl/663/356108.html

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verilog 编写源程序随机数

VHDL/FPGA/Verilog Verilog开发的I2c接口模块

Verilog开发的I2c接口模块，如何需要更详细的资料，请参考www.opencores.org网站

https://www.eeworm.com/dl/663/363333.html

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Verilog I2c 接口模块

VHDL/FPGA/Verilog 串口通讯 verilog CPLD EPM1270 源代码

串口通讯 verilog CPLD EPM1270 源代码

https://www.eeworm.com/dl/663/370395.html

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verilog CPLD 1270 EPM

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