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嵌入式/单片机编程  verilog写的回波抵消程序

verilog写的回波抵消程序，相当于写了个回波抵消的芯片，不是dsp，可编译后下载于FPGA,绝对原创，写了很长时间。

https://www.eeworm.com/dl/647/113982.html

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verilog 回波抵消程序

嵌入式/单片机编程  用verilog写的跑表程序

用verilog写的跑表程序

https://www.eeworm.com/dl/647/120716.html

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verilog 跑表程序

通讯/手机编程  曼彻斯特编解码Verilog代码 .zip

曼彻斯特编解码Verilog代码 .zip

https://www.eeworm.com/dl/527/124219.html

下载: 74

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Verilog zip 曼彻斯特代码

VHDL/FPGA/Verilog verilog编写的全功能串口

verilog编写的全功能串口

https://www.eeworm.com/dl/663/126522.html

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verilog 编写串口

VHDL/FPGA/Verilog verilog实现ALU的源代码

verilog实现ALU的源代码，并提供了一个详细的测试平台！

https://www.eeworm.com/dl/663/132035.html

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verilog ALU 源代码

VHDL/FPGA/Verilog This free cpu-ip! use verilog

This free cpu-ip! use verilog

https://www.eeworm.com/dl/663/136150.html

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verilog cpu-ip This free

VHDL/FPGA/Verilog verilog ADPLL file with testbench.v

verilog ADPLL file with testbench.v

https://www.eeworm.com/dl/663/173473.html

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testbench verilog ADPLL file

编辑器/阅读器  SOURCE INSIGHT的verilog语法插件

SOURCE INSIGHT的verilog语法插件，SOURCE INSIGHT支持自动完成等功能，是一个不错的硬件语言编辑分析器

https://www.eeworm.com/dl/626/180700.html

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INSIGHT verilog SOURCE 插件

嵌入式/单片机编程  verilog实现电子时钟模块

verilog实现电子时钟模块，输入60Hz时钟信号和复位，输出时分秒，共6位，每位7段输出用于驱动

https://www.eeworm.com/dl/647/183930.html

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verilog 电子时钟模块

VHDL/FPGA/Verilog Viterbi算法的Verilog源代码。

Viterbi算法的Verilog源代码。

https://www.eeworm.com/dl/663/184942.html

下载: 94

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Viterbi Verilog 算法源代码

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