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https://www.eeworm.com/dl/663/398993.html VHDL/FPGA/Verilog

提供一个把通信中ASK调制用VHDL来实现的例子

提供一个把通信中ASK调制用VHDL来实现的例子，内附有相应的VHDL源程序。

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#VHDL #ASK #通信 #调制

https://www.eeworm.com/dl/663/403234.html VHDL/FPGA/Verilog

一种基于移位寄存器的CAM的VHDL实现,提供下载.

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#VHDL #CAM #移位寄存器

https://www.eeworm.com/dl/663/407665.html VHDL/FPGA/Verilog

宇航级微处理器LEON2 2.2 VHDL源代码,很难找的.

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#LEON2 #VHDL #2.2 #微处理器

https://www.eeworm.com/dl/663/408728.html VHDL/FPGA/Verilog

用VHDL编写的RTL8109与单片机的接口驱动程序.

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#VHDL #8109 #RTL #编写

https://www.eeworm.com/dl/663/415874.html VHDL/FPGA/Verilog

适用异步收发器设计的vhdl语言,是学习UART知识的好例程

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#vhdl #UART #异步收发器 #语言

https://www.eeworm.com/dl/663/435631.html VHDL/FPGA/Verilog

用VHDL语言描述的工程实例频率计（在quartus 7.2中使用）

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#quartus #VHDL #7.2 #语言

https://www.eeworm.com/dl/639/437422.html 文件格式

用VHDL控制TLC5510从而实现对高速A/D器件TLC5510控制

用VHDL控制TLC5510从而实现对高速A/D器件TLC5510控制，进而处理

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#5510 #TLC #VHDL #控制

https://www.eeworm.com/dl/663/439810.html VHDL/FPGA/Verilog

用VHDL 设计的单时钟同步十进制可逆计数器的设计

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#VHDL #时钟同步 #十进制 #计数器

https://www.eeworm.com/dl/663/441689.html VHDL/FPGA/Verilog

基于VHDL设计的在quarters2上的循环码编码器

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#quarters2 #VHDL #循环码 #编码器

https://www.eeworm.com/dl/663/442481.html VHDL/FPGA/Verilog

光纤通信中的SDH数据帧解析及提取的VHDL实现源代码

光纤通信中的SDH数据帧解析及提取的VHDL实现源代码，共包含帧同步、E1及F1码流提取、DCC1码流提取、帧头开销串行输出四个主要模块

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#VHDL #SDH #光纤通信 #数据