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VHDL/FPGA/Verilog verilog hdl教程135例:verilog hdl语言类似于C语言
verilog hdl教程135例:verilog hdl语言类似于C语言，便于学习。本文档带有源代码，11-12章
VHDL/FPGA/Verilog 这是一个Verilog HDL编写的RISC cpu的程序
这是一个Verilog HDL编写的RISC cpu的程序，该程序共10个子程序，实现了简单的RISC cpu，可供初学者参考，学习硬件描述语言，及设计方法。该程序通过了modelsim仿真验证。
VHDL/FPGA/Verilog 减1计数器 一、设计要求 用Verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能
减1计数器 一、设计要求 用Verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能，可以进行自增和自减计数，其计数周期为2^N（N为二进制位数）。 二、设计原理 输入/输出说明： d：异步置数数据输入； q：当前计数器数据输出； clock：时钟脉冲； count_en：计数器计数使能控制（1：计数/0：停止计数）； updo ...
嵌入式/单片机编程 這是一堆verilog的source code.包含許多常用的小電路.還不錯用.
這是一堆verilog的source code.包含許多常用的小電路.還不錯用.
VHDL/FPGA/Verilog 加法器（使用verilog编写的）,虽然简单
加法器（使用verilog编写的）,虽然简单，但是这也是学习verilog最基础的东西！希望大家一起学习！
其他嵌入式/单片机内容 這是用verilog寫的一個簡單的處理器
這是用verilog寫的一個簡單的處理器，雖然只具有5個指令，但是可以透過這個範例，來了解到cpu的架構，與如何開發處理器，相信會有很大的啟發。
VHDL/FPGA/Verilog 用verilog编写的网卡芯片rtl级。前仿后仿都通过了
用verilog编写的网卡芯片rtl级。前仿后仿都通过了，可以在modelsim上运行察看
VHDL/FPGA/Verilog 结合XILINXCPLD所做的模拟RS232通信verilog源程序
结合XILINXCPLD所做的模拟RS232通信verilog源程序
VHDL/FPGA/Verilog 能综合的YCrCb2RGB模块（verilog)_采用3级流水线,用fpga做小数运算
能综合的YCrCb2RGB模块（verilog)_采用3级流水线,用fpga做小数运算，还有就是流水线技术
VHDL/FPGA/Verilog 我用过的verilog hdl写的SDRAM core源程序,经过测试应用
我用过的verilog hdl写的SDRAM core源程序,经过测试应用