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技术资料  数字跑表的设计

详细介绍和仿真了数字跑表的设计，里面有keil程序和仿真的步骤

https://www.eeworm.com/dl/938852.html

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数字跑表设计

单片机开发  该程序能实现数字跑表

该程序能实现数字跑表，定点报时等功能。适用于AT89S52单片机。

https://www.eeworm.com/dl/648/296457.html

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程序数字跑表

嵌入式/单片机编程  用verilog实现的数字跑表

用verilog实现的数字跑表，下载到FPGA开发板上验证通过。下载后从新分配引脚即可用。

https://www.eeworm.com/dl/647/431831.html

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verilog 数字跑表

VHDL/FPGA/Verilog 给出了数字跑表的源代码

给出了数字跑表的源代码，设计了分频模块，实现了真实的时间计数，通过这个工程的训练，能更好的了解Quartus II数字电路开发的过程。

https://www.eeworm.com/dl/663/374790.html

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数字跑表源代码

技术资料  源程序03_1 数字跑表

FPGA应用开发入门与典型实例_源程序03_1 数字跑表

https://www.eeworm.com/dl/864040.html

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FPGA 应用开发入门典型实例源程序

技术资料  跑表

电子跑表，电子跑表，电子跑表，电子跑表，电子跑表，

https://www.eeworm.com/dl/962695.html

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跑表

技术资料  跑表

设计一个跑表，计时范围为59.99秒，有计时开始和停止计时控制，复位控制可以对所有计时进行异步复位。计时结果由四位共阴极七段数码管显示。

https://www.eeworm.com/dl/981696.html

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跑表

技术资料  跑表设计

一款非常独特的跑表设计，原理、代码齐全，仅作研究使用，请勿它用。。。

https://www.eeworm.com/dl/984595.html

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跑表设计

VHDL/FPGA/Verilog verilog实现的数字跑表精确到10ms

verilog实现的数字跑表精确到10ms

https://www.eeworm.com/dl/663/454724.html

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verilog 10 ms 数字跑表

VHDL/FPGA/Verilog 一个基于FPGA的数字跑表系统的设计

一个基于FPGA的数字跑表系统的设计，最小单位是百分表位。采用十进制进位。

https://www.eeworm.com/dl/663/452031.html

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FPGA 数字跑表

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单片机开发  该程序能实现数字跑表

嵌入式/单片机编程  用verilog实现的数字跑表

VHDL/FPGA/Verilog 给出了数字跑表的源代码

技术资料  源程序03_1 数字跑表

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VHDL/FPGA/Verilog verilog实现的数字跑表精确到10ms

VHDL/FPGA/Verilog 一个基于FPGA的数字跑表系统的设计