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数字跑表 的查询结果
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单片机开发 该程序能实现数字跑表
该程序能实现数字跑表，定点报时等功能。
适用于AT89S52单片机。
VHDL/FPGA/Verilog 数字跑表 该跑表具有启动、复位、暂停、暂停后继续计时等功能 能显示的秒计数时间精确到小数点后第二位
数字跑表
该跑表具有启动、复位、暂停、暂停后继续计时等功能
能显示的秒计数时间精确到小数点后第二位，即能显示**.**s
按钮设置防抖
VHDL/FPGA/Verilog 给出了数字跑表的源代码
给出了数字跑表的源代码，设计了分频模块，实现了真实的时间计数，通过这个工程的训练，能更好的了解Quartus II数字电路开发的过程。
嵌入式/单片机编程 用verilog实现的数字跑表
用verilog实现的数字跑表，下载到FPGA开发板上验证通过。下载后从新分配引脚即可用。
VHDL/FPGA/Verilog 一个基于FPGA的数字跑表系统的设计
一个基于FPGA的数字跑表系统的设计，最小单位是百分表位。采用十进制进位。
VHDL/FPGA/Verilog verilog实现的数字跑表 精确到10ms
verilog实现的数字跑表 精确到10ms
技术资料 数字跑表6位数码显示Multisim源文件 Multisim13以上版本可打开运行
数字跑表6位数码显示Multisim源文件,Multisim13以上版本可打开运行
VHDL/FPGA/Verilog VERILOG设计实例
VERILOG设计实例，非常详细的例子，有交通灯，频率计，数字跑表等等例子
VHDL/FPGA/Verilog 软件开发环境：ISE 7.1i 仿真环境：ModelSim SE 6.0 1. 这个实例实现通过ModelSim工具实现一个具有“百分秒
软件开发环境：ISE 7.1i
仿真环境：ModelSim SE 6.0
1. 这个实例实现通过ModelSim工具实现一个具有“百分秒，秒，分”计时功能的数字跑表；
2. 工程在project文件夹中，双击paobiao.ise文件打开工程；
3. 源文件在rtl文件夹中，paobiao.v为设计文件，paobiao_tb.tbw是仿真测试文件；
4. 打开工程后，在工程浏览器中选择pa ...
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多功能电子钟，实现定时闹钟，数字跑表，设定日期和时间等功能，基于fpga的设计