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小数分频器 的查询结果
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VHDL/FPGA/Verilog FPGA开发经常用到分频
FPGA开发经常用到分频，分频固然简单，但是本程序可以实现任意占空比任意分频，用verilog编写，非常好用。
VHDL/FPGA/Verilog 实现任意奇数偶数分频的 模块
实现任意奇数偶数分频的 模块 ，而且占空比为50 ，本人一直在用，很好用！
书籍源码 用NEC编码方式写的红外发送程序,包括三个部分,分频,编码,编码输出
用NEC编码方式写的红外发送程序,包括三个部分,分频,编码,编码输出
VHDL/FPGA/Verilog 实现对时钟信号的技术分频
实现对时钟信号的技术分频，程序简单易懂，对于初学VHDL者来说，提供了一个良好的方法。
VHDL/FPGA/Verilog 一种实现任意整数分频的ＶＨＤＬ源代码
一种实现任意整数分频的ＶＨＤＬ源代码，已经经过调试
其他 VERILOG实现无分频时钟
VERILOG实现无分频时钟，包括测试文件，经过验证可用
VHDL/FPGA/Verilog VHDL描述的时钟分频电路
VHDL描述的时钟分频电路，用途广...
其他 VHDL 的一个流水灯程序 开发平台Quartusii 使用的延时方法为分频思想
VHDL 的一个流水灯程序 开发平台Quartusii
使用的延时方法为分频思想
VHDL/FPGA/Verilog 关于基数分频技巧设计,基于VHDL语言,对实际设计有帮助
关于基数分频技巧设计,基于VHDL语言,对实际设计有帮助
嵌入式/单片机编程 4位可逆计数器：将50MHz的时钟进行 分频后的结果作为时钟控制
4位可逆计数器：将50MHz的时钟进行 分频后的结果作为时钟控制，根据输入进行条件判断，再通过设置一个四位的向量将结果输出，利用数码管显示在实验板上