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技术资料 降压型直流开关稳压电源

LM5116 是一款用于由高压或宽范围变化输入电源供电的降压稳压器应用的同步降压控制器。 此控制方法基于采用 一个经仿真电流斜坡的电流模式控制。 电流模式控制可提供固有的线路前馈、逐周期电流限制和简化的环路补偿。 经仿真控制斜坡的使用减少了脉宽调制电路的噪声敏感度,从而实现高输入电压应用中所必需的对极小占空比 ...
https://www.eeworm.com/dl/838091.html
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技术资料 基于Saber进行传导发射的FFT仿真分析方法

随着通讯技术和计算机技术在汽车电子产品中的应用,电磁兼容问题日益严重。汽车电磁兼容问题关系汽车特定电子系统及其周围电子系统运行的安全可靠性,如汽车电子控制制动系统、电子控制传动系统、电子控制转向系统等。因此对于现代汽车而言,电磁兼容技术、排放技术与安全技术同为汽车共性技术。如何在最短的时间内开发出性 ...
https://www.eeworm.com/dl/840376.html
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技术资料 模拟PWM调光-理解PWM原理

模拟PWM调光-理解PWM原理无级的意思是指连续变化的、而不是跃变式或分档的,是斜坡式的、而不是台阶式的。  模拟调光是指控制信号是模拟量、而不是数字量。在设定的某个亮度下,灯的亮度在任意长短的时间中都是一样的,这就是“模拟”的意思。模拟调光可以是分档的,也可以是无级的。  PWM是脉冲宽度调制的英文缩 ...
https://www.eeworm.com/dl/846648.html
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技术资料 利用单片机技术提高高校图书馆人员空间资源利用率的研究

本论文主要应用单片机智能控制技术,形成以单片机为控制模块,红外线传感器超声波传感器为信息采集模块,Led数码管为信息显示模块的一个智能控制系统,将这套智能化模块应用到图书馆中,在人力资源及空间资源方面提高资源利用率,解决资源浪费的问题。通过单片机控制信息集采模块,收集所需信息。这套系统能自动地记录高校图书馆在 ...
https://www.eeworm.com/dl/895574.html
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技术资料 基于FPGA和单片机的高精度数字频率计的设计与实现

本文主要介绍了一种基于FPGA和单片机的高精度数字频率计的设计与实现。51单片机实现计算功能,液晶屏完成数据显示,FPGA对被测信号计数并将测量结果发送给单片机。实现了频率范围为1Hz~10MHz、有效电压范围为50mV~1V的正弦波信号频率和周期的测量;以及频率范围在100Hz~1MHz、峰峰值电压范围50mV~1V的两路同频周期方波信号的时 ...
https://www.eeworm.com/dl/898089.html
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VHDL/Verilog/EDA源码 FIFO FPGA

异步FIFO是一种先进先出的电路,使用在需要产时数据接口的部分,用来存储、缓冲在两个异步时钟之间的数据传输。在异步电路中,由于时钟之间周期和相位完全独立,因而数据的丢失概率不为零。如何设计一个高可靠性、高速的异步FIFO电路便成为一个难点。本设计介绍解决这一问题的一种方法。本设计采用VHDL语言的形式,在Quartu ...
https://www.eeworm.com/dl/504/14089.html
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单片机编程 ARM7与MSP430单片机的区别

MSP430和ARM7是两个完全不同体系构架的处理器,因此虽一些在应用上具有共性的问题做个简要比较。 目前在应用中比较普遍关心的是 速度和功耗、 应用范围、内部资源、硬件设计、设计周期、成本考虑    
https://www.eeworm.com/dl/502/29117.html
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单片机编程 基于Avalon总线的8051MCU IP核的设计

设计了一款基于Avalon总线的8051MCU IP核。它支持MCS-51指令集,优化内部的结构,通过采用流水线技术、指令映射技术、指令预取技术、微代码技术等极大的提高了IP核的工作速度,使IP核在100MHz时钟下,能够单周期执行一条指令。本设计使用Modelsim软件完成了功能仿真和时序仿真,并在以Altera 公司的Cyclone II FPGA芯片为核 ...
https://www.eeworm.com/dl/502/29481.html
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单片机编程 P89LPC932A1 Flash单片机使用指南

概述 P89LPC932A1是一款单片封装的微控制器,适合于许多要求高集成度、低成本的场合。可以满足多方面的性能要求。P89LPC932A1采用了高性能的处理器结构,指令执行时间只需2到4个时钟周期。6倍于标准80C51器件。P89LPC932A1集成了许多系统级的功能,这样可大大减少元件的数目、电路板面积以及系统的成本。 ...
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VHDL/FPGA/Verilog 减1计数器 一、设计要求 用Verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能

减1计数器 一、设计要求 用Verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能,可以进行自增和自减计数,其计数周期为2^N(N为二进制位数)。 二、设计原理 输入/输出说明: d:异步置数数据输入; q:当前计数器数据输出; clock:时钟脉冲; count_en:计数器计数使能控制(1:计数/0:停止计数); updo ...
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