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数值算法/人工智能 针对时间序列的复杂性测试
针对时间序列的复杂性测试，实现快速近似熵算法，可以分析确定信号和随机信号，速度打打提高
其他 使用vhdl编写的一段程序。 主要功能是声音周期计算
使用vhdl编写的一段程序。
主要功能是声音周期计算，以区别声音信号与噪音信号。
通讯/手机编程 ｉｉｒ数字滤波器契比雪夫设计方法
ｉｉｒ数字滤波器契比雪夫设计方法，其中涉及到输入信号输出信号的频谱分析
通讯/手机编程 ｉｉｒ数字滤波器直接i型的dsp实现
ｉｉｒ数字滤波器直接i型的dsp实现，其中涉及到输入信号输出信号的频谱分析
其他嵌入式/单片机内容 此程序可以显示输入波形
此程序可以显示输入波形，当你输入的是模批信号在此程序内转为数字信号，然后在屏上显示
VHDL/FPGA/Verilog 简单可编程中断控制器
简单可编程中断控制器，利用定时计数器的中断请求信号输出中断使能控制信号。
VHDL/FPGA/Verilog 输入时钟
输入时钟，可以得到周期性的有效信号以及同步信号，同时可以随时钟输出8个字节的数据
技术资料 AES转I2S程序Verilog
用于将AES3标准格式的音频信号，转换成I2S格式的音频信号。Verilog HDL。