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技术资料 分频器

一种新型分频器,可实现任意分数的分频,也可以扩展到小数分频
https://www.eeworm.com/dl/930756.html
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技术资料 分频器

分频器,可应用于数字钟中的时分的分频。也可以作为单个的分频器
https://www.eeworm.com/dl/976849.html
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技术资料 verilog半分频

采用Verilog实现参考时钟的非整数分频功能,支持n+0.5分频模式,适用于需要精确控制输出脉宽的场景。基于同步逻辑设计,确保时序稳定可靠,提升系统时钟灵活性与精度。
https://www.eeworm.com/dl/1005294.html
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VHDL/FPGA/Verilog 课程设计-分频计 能够很好的实现分频功能

课程设计-分频计 能够很好的实现分频功能
https://www.eeworm.com/dl/663/292082.html
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汇编语言 verilog写的分频程序,可以对输入的频率分频

verilog写的分频程序,可以对输入的频率分频
https://www.eeworm.com/dl/644/361321.html
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单片机开发 实用的任意时钟分频Verilog代码 可以任意分频的!

实用的任意时钟分频Verilog代码 可以任意分频的!
https://www.eeworm.com/dl/648/384259.html
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VHDL/Verilog/EDA源码 整数倍分频

整数倍分频,有多种分频方式(包括1倍分频、奇偶数分频)
https://www.eeworm.com/dl/504/11108.html
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书籍源码 任意整数分频

任意整数分频,很好,欢迎大家使用,有疑问请即时跟我联系
https://www.eeworm.com/dl/532/285696.html
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VHDL/FPGA/Verilog VHDL分频器

VHDL分频器,利用分频比较错法,要实现K=324/28=8.3571428571...的分频周期为28,18个8分频和10个9分频循环,所以设一个0到27的循环计数器,每当1、4、7、10、13、16、19、22、27时进行9分频,其他时为8分频;为使占空比尽量接近50%,需要在每一个8或9分频中设定一下输出几个时钟的0和1。 ...
https://www.eeworm.com/dl/663/301929.html
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VHDL/FPGA/Verilog 任意奇数分频

任意奇数分频,只要修改N即可实现 可验证
https://www.eeworm.com/dl/663/344912.html
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