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📄 clock.pin

📁 用verilog实现的数字跑表
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GND                          : 138       : gnd    :                   :         :           :                
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dataout[0]                   : 218       : output : 3.3-V LVTTL       :         : 3         : N              
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GNDA_PLL3                    : 239       : gnd    :                   :         :           :                
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