watch.tan.rpt
来自「一个用VHDL编程基于CPLD的EDA实验板开发可以实现顺计时和倒计时的秒表。要」· RPT 代码 · 共 296 行 · 第 1/5 页
RPT
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; N/A ; 43.48 MHz ( period = 23.000 ns ) ; keyscan:inst8|treg1[10] ; display:inst6|bcd[2] ; CLK ; CLK ; None ; None ; 18.000 ns ;
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