line_control.v

来自「Use the verilog language write a MIPS CP」· Verilog 代码 · 共 16 行

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//Line control Module: control to be or not to be change two line
//	input control;
//	input [31:0] Datain1, Datain2;
//	output [31:0] Dataout1, Dataout2;
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module Line_control( control, Datain1, Datain2, Dataout1, Dataout2);
	input control;
	input [31:0] Datain1, Datain2;
	output [31:0] Dataout1, Dataout2;

	assign Dataout1 = ( control ) ? Datain2 : Datain1;
	assign Dataout2 = ( control ) ? Datain1 : Datain2;

endmodule