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技术文档 VHDL/FPGA/Verilog 人工审核无毒

VHDL实现的电子钟的基本功能

所属分类 VHDL/FPGA/Verilog
文件大小 434 K
文件格式 RAR 文件
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资料详细技术说明

VHDL实现的电子钟的基本功能，带QUARTUE工程文件

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clock.root_partition.map.kpt 12.8 KB
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2 FILE
readme 653 B
包内组件
3 FILE
clock.map.rpt 20.2 KB
包内组件
4 FILE
clock.vwf 28.7 KB
包内组件
5 FILE
clock.asm.rpt 6.1 KB
包内组件
6 FILE
decoder.vhd.bak 903 B
包内组件
7 FILE
clock.sdc 1.2 KB
包内组件
8 FILE
clock.fit.rpt 76.5 KB
包内组件
9 FILE
clock.fit.smsg 334 B
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10 FILE
clock.pof 14.7 KB
包内组件
11 FILE
clock.vhd 3.2 KB
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12 FILE
clock.tan.rpt 43.5 KB
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