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电子书籍 VHDL/FPGA/Verilog 人工审核无毒

用vhdl设计实现的多功能电子钟

所属分类 VHDL/FPGA/Verilog
文件大小 1483 K
文件格式 RAR 文件
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资料详细技术说明

用vhdl设计实现的多功能电子钟，可有日历，闹钟，修改等多种功能

压缩包内文件清单（共 12 个文件）

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read me.txt 106 B
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up3_clock.vhd 46.7 KB
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3 FILE
up3_clock.done 26 B
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up3_clock.qsf 2.9 KB
包内组件
5 FILE
up3_clock.fit.smsg 411 B
包内组件
6 FILE
up3_clock.fit.summary 412 B
包内组件
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up3_clock.asm.rpt 9.3 KB
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8 FILE
up3_clock.vwf 41.8 KB
包内组件
9 FILE
up3_clock.qpf 904 B
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10 FILE
up3_clock.sim.rpt 572.1 KB
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up3_clock.flow.rpt 4.2 KB
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12 FILE
up3_clock.pin 29.6 KB
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