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利用VHDL语言设计一个电子时钟
利用VHDL语言设计一个电子时钟
VHDL/FPGA/Verilog
60 K
179 次下载
2017-09-04
资源详细信息
文件格式
压缩包
文件大小
60 K
资源分类
VHDL/FPGA/Verilog
上传者
guigui2008q
发布时间
2017-09-04 00:54
下载统计
179
次
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2 积分
利用VHDL语言设计一个电子时钟 - 资源详细说明
利用VHDL语言设计一个电子时钟,包含相应的设计子程序及仿真结果
利用VHDL语言设计一个电子时钟 - 源码文件列表
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1
电子时钟vhdl程序与仿真.doc
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