Altera IP核8B10B编码器的完整设计流程包括Altera IP的定制、仿真和实现的全过程 - 免费下载

VHDL/FPGA/Verilog资源 文件大小：387 K

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文件格式
RAR
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VHDL/FPGA/Verilog
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Altera IP核8B10B编码器的完整设计流程包括Altera IP的定制、仿真和实现的全过程

源码文件列表

📂 共 34 个源码文件 点击文件名可在线查看源代码

1 📄
wave.do
大小: 1.38 KB
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2 📄
sim.do
大小: 172 B
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3 📄
altera_mf.v
大小: 64 KB
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4 📄
220model.v
大小: 64 KB
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5 📄
sgate.v
大小: 26.01 KB
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6 📄
enc.bsf
大小: 4.25 KB
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7 📄
wave.do
大小: 1.38 KB
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8 📄
sim.do
大小: 172 B
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9 📄
enc_tb.v
大小: 8.65 KB
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10 📄
enc.vo
大小: 154 B
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11 📄
altera_mf.v
大小: 64 KB
查看源码
12 📄
220model.v
大小: 64 KB
查看源码
13 📄
sgate.v
大小: 26.01 KB
查看源码
14 📄
topip.qsf
大小: 3.51 KB
查看源码
15 📄
enc.bsf
大小: 4.25 KB
查看源码
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