VHDL的数字时钟程序 24小时计数显示；具有校时功能（时 - 免费下载

VHDL/FPGA/Verilog资源文件大小：13 K

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VHDL/FPGA/Verilog

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2014-01-09 13:59

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VHDL的数字时钟程序 24小时计数显示；具有校时功能（时，分）；实现闹钟功能（定时，闹响）；

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