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VHDL/FPGA/Verilog
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32 risc cpu的参考设计
32 risc cpu的参考设计
VHDL/FPGA/Verilog
2388 K
23 次下载
2017-01-14
资源详细信息
文件格式
RAR
文件大小
2388 K
资源分类
VHDL/FPGA/Verilog
上传者
snowpilce
发布时间
2017-01-14 00:56
下载统计
23
次
所需积分
2 积分
32 risc cpu的参考设计 - 资源详细说明
32 risc cpu的参考设计,内涵完整的testbench
32 risc cpu的参考设计 - 源码文件列表
本资源包含 29 个源码文件
支持在线预览,点击文件名即可查看
1
regfile.h
查看源码
2
hdllib.ref
查看源码
3
prom.h
查看源码
4
glbl.h
查看源码
5
icache.h
查看源码
6
wb__connect.h
查看源码
7
forward.h
查看源码
8
wb__arbiter.h
查看源码
9
flash__wbbus.h
查看源码
10
write__back.h
查看源码
11
reg__mem.h
查看源码
12
reg__if.h
查看源码
13
cpu.h
查看源码
14
sdram__wbbus.h
查看源码
15
decode.h
查看源码
查看完整源码列表 (共 29 个文件) →
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