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RS232 verilog design

VHDL/FPGA/Verilog 113 K 83 次下载 2013-12-23

资源详细信息

文件格式

RAR

文件大小

113 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2013-12-23 05:11

下载统计

83 次

所需积分

2 积分

RS232 verilog design - 资源详细说明

RS232 verilog design

RS232 verilog design - 源码文件列表

本资源包含 18 个源码文件支持在线预览，点击文件名即可查看

1

asynchronous communication.htm

2

async_transmitter.v

3

serial interface1.htm

4

async-start.gif

5

async-sr.gif

6

async.gif

7

async-clock.gif

8

serialtxdmodule.gif

9

async_receiver.v

10

serial interface2.htm

11

serialrxdmodule.gif

12

serial interface5.htm

13

serial interface3.htm

14

serial interface4.htm

15

asynchronous communication and design.doc

查看完整源码列表 (共 18 个文件) →

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