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时序电路——抢答器
时序电路——抢答器
VHDL/FPGA/Verilog
96 K
33 次下载
2013-12-06
资源详细信息
文件格式
RAR
文件大小
96 K
资源分类
VHDL/FPGA/Verilog
上传者
wc7707399
发布时间
2013-12-06 14:14
下载统计
33
次
所需积分
2 积分
时序电路——抢答器 - 资源详细说明
时序电路——抢答器,K1、K2、K3、K4各控制一个按钮,DJ代表主持人,在抢答开始前,DJ先按一下按钮,然后在开始比赛,K1—K4中任意按下按钮后,其他钮按下均无效,重新比赛时,DJ需要再按一下按钮。抢答结果用LED显示。
时序电路——抢答器 - 源码文件列表
本资源包含 1 个源码文件
支持在线预览,点击文件名即可查看
1
vhdl3.doc
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