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计数器锁存器 12位寄存器带load

VHDL/FPGA/Verilog 12 K 63 次下载 2014-01-16

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文件格式

RAR

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12 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2014-01-16 04:13

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63 次

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2 积分

计数器锁存器 12位寄存器带load - 资源详细说明

计数器锁存器 12位寄存器带load，clr等功能的寄存器双向脚（clocked bidirectional pin）一个简单的状态机一个同步状态机用状态机设计的交通灯控制器数据接口一个简单的UART 测试向量（Test Bench）举例：加法器源程序相应加法器的测试向量test bench）

计数器锁存器 12位寄存器带load - 源码文件列表

本资源包含 13 个源码文件支持在线预览，点击文件名即可查看

1

带load，clr等功能的寄存器.v

2

元件例化与层次设计.txt

3

一个简单的uart.v

4

计数器.v

5

transcript

6

锁存器.v

7

双向脚（clocked bidirectional pin）.txt

8

用状态机设计的交通灯控制器.v

9

一个简单的状态机.v

10

相应加法器的测试向量（test bench).v

11

12位寄存器.v

12

verilog hdl 实例说明.doc

13

一个同步状态机.txt

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#计数器 #锁存器 #寄存器 #状态机 #UART

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