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VHDL/FPGA/Verilog
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这是一个定时比较器
这是一个定时比较器
VHDL/FPGA/Verilog
353 K
27 次下载
2013-12-26
资源详细信息
文件格式
RAR
文件大小
353 K
资源分类
VHDL/FPGA/Verilog
上传者
ahkid
发布时间
2013-12-26 21:31
下载统计
27
次
所需积分
2 积分
这是一个定时比较器 - 资源详细说明
这是一个定时比较器,当数据a和b高几位一致时再对数据进行比较,可以根据自己设计进行相关参数修改
这是一个定时比较器 - 源码文件列表
本资源包含 100 个源码文件
支持在线预览,点击文件名即可查看
1
new_compare.qsf
查看源码
2
new_duty.quartus.talkback.xml
查看源码
3
new_compare.sim.talkback.xml
查看源码
4
compare1.gui.talkback.xml
查看源码
5
new_duty.map.talkback.xml
查看源码
6
compare1.quartus.talkback.xml
查看源码
7
compare1.sim.talkback.xml
查看源码
8
new_compare.map.talkback.xml
查看源码
9
compare1.map.talkback.xml
查看源码
10
new_compare.gui.talkback.xml
查看源码
11
new_duty.sim.talkback.xml
查看源码
12
new_duty.gui.talkback.xml
查看源码
13
new_duty.map.eqn
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14
new_duty.bsf
查看源码
15
new_duty.qpf
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