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Verilog HDL编写的总线功能模型

VHDL/FPGA/Verilog 3 K 58 次下载 2013-12-20

资源详细信息

文件格式

RAR

文件大小

3 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2013-12-20 14:18

下载统计

58 次

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2 积分

Verilog HDL编写的总线功能模型 - 资源详细说明

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