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VHDL/FPGA/Verilog
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采用Verilog HDL语言编写的多功能数字钟
采用Verilog HDL语言编写的多功能数字钟
VHDL/FPGA/Verilog
3178 K
108 次下载
2016-03-21
资源详细信息
文件格式
RAR
文件大小
3178 K
资源分类
VHDL/FPGA/Verilog
上传者
limaoxiansheng
发布时间
2016-03-21 10:59
下载统计
108
次
所需积分
2 积分
采用Verilog HDL语言编写的多功能数字钟 - 资源详细说明
采用Verilog HDL语言编写的多功能数字钟,包括四个功能:时间显示与设置、秒表、闹钟、日期显示与设置,源代码对FPGA和CPLD学习者价值很高,
采用Verilog HDL语言编写的多功能数字钟 - 源码文件列表
本资源包含 80 个源码文件
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1
minute_counter.eds_overflow
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2
minute_counter.fit.qmsg
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3
minute_counter.map.qmsg
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4
minute_counter.sim.qmsg
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5
minute_counter.sim.vwf
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6
minute_counter.tan.qmsg
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7
minute_counter.hier_info
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8
minute_counter.asm.qmsg
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9
minute_counter.db_info
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10
minute_counter.hif
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11
hour_counter.eds_overflow
查看源码
12
hour_counter.sim.vwf
查看源码
13
hour_counter.map.qmsg
查看源码
14
hour_counter.sim.qmsg
查看源码
15
hour_counter.hier_info
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