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VHDL/FPGA/Verilog
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比特序列传送模块 把输入的八位比特数据 做循环后每个比特输
比特序列传送模块 把输入的八位比特数据 做循环后每个比特输出 详细请看英文描述
VHDL/FPGA/Verilog
3 K
59 次下载
2013-12-12
资源详细信息
文件格式
RAR
文件大小
3 K
资源分类
VHDL/FPGA/Verilog
上传者
moxcki
发布时间
2013-12-12 02:03
下载统计
59
次
所需积分
2 积分
比特序列传送模块 把输入的八位比特数据 做循环后每个比特输出 详细请看英文描述 - 资源详细说明
比特序列传送模块 把输入的八位比特数据 做循环后每个比特输出 详细请看英文描述
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1
txsys.ucf
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2
test_txsystem.v
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3
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