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VHDL/FPGA/Verilog
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利用Verilog语言进行FIFO设计
利用Verilog语言进行FIFO设计
VHDL/FPGA/Verilog
172 K
54 次下载
2017-03-16
资源详细信息
文件格式
RAR
文件大小
172 K
资源分类
VHDL/FPGA/Verilog
上传者
lxwcqq
发布时间
2017-03-16 00:15
下载统计
54
次
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2 积分
利用Verilog语言进行FIFO设计 - 资源详细说明
利用Verilog语言进行FIFO设计,在FPGA中实现32X8FIFO功能
利用Verilog语言进行FIFO设计 - 源码文件列表
本资源包含 2 个源码文件
支持在线预览,点击文件名即可查看
1
基于verilog hdl语言的32x8 fifo设计.pdf
查看源码
2
高速异步fifo的实现.pdf
查看源码
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