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VHDL/FPGA/Verilog
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用verilog编写的高速8路并行dds模块
用verilog编写的高速8路并行dds模块
VHDL/FPGA/Verilog
6 K
96 次下载
2014-01-04
资源详细信息
文件格式
RAR
文件大小
6 K
资源分类
VHDL/FPGA/Verilog
上传者
dounob
发布时间
2014-01-04 00:55
下载统计
96
次
所需积分
2 积分
用verilog编写的高速8路并行dds模块 - 资源详细说明
用verilog编写的高速8路并行dds模块,用于与高速da(1ghz或以上)接口产生任意频率正弦波,模块已经经过工程验证,用于产品中。
用verilog编写的高速8路并行dds模块 - 源码文件列表
本资源包含 3 个源码文件
支持在线预览,点击文件名即可查看
1
dds_iq_tap8.v
查看源码
2
dds_cos_rom.mif
查看源码
3
dds_sin_rom.mif
查看源码
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