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VHDL/FPGA/Verilog
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使用verilog完成了RS编码的设计
使用verilog完成了RS编码的设计
VHDL/FPGA/Verilog
15 K
63 次下载
2017-01-23
资源详细信息
文件格式
RAR
文件大小
15 K
资源分类
VHDL/FPGA/Verilog
上传者
scorpioll
发布时间
2017-01-23 20:31
下载统计
63
次
所需积分
2 积分
使用verilog完成了RS编码的设计 - 资源详细说明
使用verilog完成了RS编码的设计,编码参数为输入188,输出204
使用verilog完成了RS编码的设计 - 源码文件列表
本资源包含 11 个源码文件
支持在线预览,点击文件名即可查看
1
rom_inv.mif
查看源码
2
cheinsearch.v
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3
ff_mul.v
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4
rom_power.v
查看源码
5
rom_inv.v
查看源码
6
rom_power.mif
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7
rs(204,188)译码器说明.txt
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8
rs_decoder.v
查看源码
9
syndromecalc.v
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10
forney.v
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11
bm_kes.v
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