rs编解码的verilog实现源代码，从硬件实现rs的编解码
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decontroller.v
16.6 KB
包内组件
2
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top.map.eqn
411.5 KB
包内组件
3
FILE
adderror_test.vwf
5.3 KB
包内组件
4
FILE
rsencode.v
2.3 KB
包内组件
5
FILE
top.pin
29.5 KB
包内组件
6
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top.fit.summary
410 B
包内组件
7
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top.cdf
279 B
包内组件
8
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top.fit.rpt
199.6 KB
包内组件
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top.done
26 B
包内组件
10
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top.map.rpt
190.4 KB
包内组件
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top.sof
137.2 KB
包内组件
12
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pll_bb.v
7.8 KB
包内组件