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组合电路的设计8位加法器设计(ADD8.vhd)
组合电路的设计8位加法器设计(ADD8.vhd)
VHDL/FPGA/Verilog
56 K
109 次下载
2016-10-13
资源详细信息
文件格式
RAR
文件大小
56 K
资源分类
VHDL/FPGA/Verilog
上传者
dxhh
发布时间
2016-10-13 00:34
下载统计
109
次
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2 积分
组合电路的设计8位加法器设计(ADD8.vhd) - 资源详细说明
组合电路的设计8位加法器设计(ADD8.vhd)
组合电路的设计8位加法器设计(ADD8.vhd) - 源码文件列表
本资源包含 34 个源码文件
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1
u6918174.dls
查看源码
2
add8.sym
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3
u8997966.dls
查看源码
4
add8.ndb
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5
u4669455.dls
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6
add2.sym
查看源码
7
add2.mmf
查看源码
8
add8.scf
查看源码
9
add2.pin
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10
add8.rpt
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11
add2.cnf
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12
lib.dls
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13
add2.hif
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14
add2.vhd
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15
add8.pin
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