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介绍了viterbi译码器的编解码器的设计

VHDL/FPGA/Verilog 62 K 109 次下载 2013-12-20

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RAR

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62 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2013-12-20 16:06

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109 次

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介绍了viterbi译码器的编解码器的设计 - 资源详细说明

介绍了viterbi译码器的编解码器的设计，包括decoder.v,encoder.v.control.v,ram.v等，压缩包里面有pdf说明

介绍了viterbi译码器的编解码器的设计 - 源码文件列表

本资源包含 12 个源码文件支持在线预览，点击文件名即可查看

1

viterbi译码文档.pdf

2

bmg.v

3

params.v

4

decoder.v

5

mmu.v

6

dff.v

7

viterbi_encode9.v

8

tbu.v

9

testbench.v

10

ram.v

11

control.v

12

acs.v

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