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基于fpga和sopc的用VHDL语言编写的EDA含异步清0
基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器
嵌入式/单片机编程
35 K
121 次下载
2014-01-17
资源详细信息
文件格式
RAR
文件大小
35 K
资源分类
嵌入式/单片机编程
上传者
wjm197811
发布时间
2014-01-17 07:19
下载统计
121
次
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2 积分
基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器 - 资源详细说明
基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器
基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器 - 源码文件列表
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1
tri2.vhd
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2
stp1.stp
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3
sim.cfg
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cnt10b.vhd
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cnt10.fit.eqn
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6
cnt10.vwf
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7
cnt10.map.summary
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8
flatsch.sxr
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9
cnt10.cdf
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10
cnt10.map.rpt
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11
cnt10.qws
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12
cnt10.pin
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13
cnt10.done
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14
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15
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