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VHDL/FPGA/Verilog
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用VHDL编写的计算器
用VHDL编写的计算器
VHDL/FPGA/Verilog
22 K
93 次下载
2014-01-17
资源详细信息
文件格式
RAR
文件大小
22 K
资源分类
VHDL/FPGA/Verilog
上传者
villyc
发布时间
2014-01-17 08:00
下载统计
93
次
所需积分
2 积分
用VHDL编写的计算器 - 资源详细说明
用VHDL编写的计算器,能实现简单的加减乘除四则运算
用VHDL编写的计算器 - 源码文件列表
本资源包含 14 个源码文件
支持在线预览,点击文件名即可查看
1
div.vhd
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2
top.ucf
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3
fadd.vhd
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4
sub.vhd
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5
add.vhd
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6
add1.vhd
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7
top.bit
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8
top.vhd
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9
key_ctrl.vhd
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10
mul2.vhd
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11
sign.vhd
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12
mul.vhd
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13
fadd4.vhd
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14
segment.vhd
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