基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码 - 免费下载

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baorong216

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2013-08-18 17:00

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基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等

源码文件列表

📂 共 1184 个源码文件点击文件名可在线查看源代码

1 📄

time_auto_and_set.tan.rpt

大小: 64 KB

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2 📄

time_mux.v

大小: 1.26 KB

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3 📄

time_auto_and_set.flow.rpt

大小: 4.01 KB

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4 📄

time_auto_and_set.vwf

大小: 17.13 KB

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5 📄

hour_counter.v

大小: 633 B

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6 📄

timeset.v

大小: 2.15 KB

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7 📄

time.v

大小: 3.5 KB

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8 📄

time_auto_and_set.pof

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9 📄

time_auto_and_set.map.summary

大小: 284 B

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10 📄

time_auto_and_set.sim.rpt

大小: 4.33 KB

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11 📄

time_auto_and_set.v

大小: 2.44 KB

查看源码

12 📄

time_auto_and_set.bsf

大小: 4.37 KB

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13 📄

time_auto_and_set.pin

大小: 13.12 KB

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14 📄

time_auto_and_set.asm.rpt

大小: 8.23 KB

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15 📄

time_auto_and_set.qpf

大小: 1.53 KB

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