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通过VHDL语言编写的计数器程序,可以在一吗器显示管上分段显
通过VHDL语言编写的计数器程序,可以在一吗器显示管上分段显示小时,分,秒,并且可以分别清零
VHDL/FPGA/Verilog
84 K
46 次下载
2013-12-16
资源详细信息
文件格式
RAR
文件大小
84 K
资源分类
VHDL/FPGA/Verilog
上传者
jellylihui
发布时间
2013-12-16 01:38
下载统计
46
次
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2 积分
通过VHDL语言编写的计数器程序,可以在一吗器显示管上分段显示小时,分,秒,并且可以分别清零 - 资源详细说明
通过VHDL语言编写的计数器程序,可以在一吗器显示管上分段显示小时,分,秒,并且可以分别清零
通过VHDL语言编写的计数器程序,可以在一吗器显示管上分段显示小时,分,秒,并且可以分别清零 - 源码文件列表
本资源包含 53 个源码文件
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1
counterx.sim.rpt
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2
counterx.map.eqn
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3
counterx.pin
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4
counterx.fit.summary
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5
counterx.map.rpt
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6
counterx.qpf
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7
counterx.done
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8
counterx.asm.rpt
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9
counterx.pof
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10
counterx.sof
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11
counterx.qsf
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12
counterx.flow.rpt
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13
counterx.vwf
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14
counterx.fit.eqn
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15
counterx.vhd
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