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本代码是用VRILOG语言写的SDRAM的控制器的标准代码,供开发SARM参考.

VHDL/FPGA/Verilog 759 K 80 次下载 2014-01-14

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759 K

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VHDL/FPGA/Verilog

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2014-01-14 08:52

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本代码是用VRILOG语言写的SDRAM的控制器的标准代码,供开发SARM参考. - 资源详细说明

本代码是用VRILOG语言写的SDRAM的控制器的标准代码,供开发SARM参考.

本代码是用VRILOG语言写的SDRAM的控制器的标准代码,供开发SARM参考. - 源码文件列表

本资源包含 11 个源码文件支持在线预览，点击文件名即可查看

1

readme_sdr_sdram.txt

2

sdr_sdram_tb.v

3

control_interface.v

4

sdr_sdram.v

5

params.v

6

sdr_data_path.v

7

compile_all.v

8

command.v

9

altclklock.v

10

pll1.v

11

sdr_sdram.pdf

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